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单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
数据手册
  • 1+

    ¥221.89
  • 30+

    ¥210.01
  • 有货
    • 1+

      ¥228.56
    • 30+

      ¥218.05
  • 有货
    • 1+

      ¥234.4448 ¥308.48
    • 30+

      ¥223.2272 ¥293.72
  • 有货
  • CPLD的CoolRunner XPLA3(扩展可编程逻辑阵列)系列适用于包括便携式、手持和功率敏感应用的低功耗系统。该系列的每个成员都采用了快速零功耗(FZP)设计技术,结合了低功耗和高速。通过这种设计技术,CoolRunner XPLA3系列可实现5.0 ns的真正引脚到引脚速度,同时在待机时无需“涡轮位”或其他掉电方案,功耗低于56 μW。通过用纯CMOS门的级联链取代传统的用于实现乘积项的感测放大器方法(自双极时代以来PLD中一直使用的技术),动态功耗也比任何其他CPLD低得多。CoolRunner器件是唯一的全CMOS PLD,因为它们同时使用CMOS工艺技术和获得专利的全CMOS FZP设计技术。FZP设计技术将快速非易失性存储单元与超低功耗SRAM影子存储器相结合,提供了业界功耗最低的3.3V CPLD系列
    数据手册
    • 1+

      ¥286.3891 ¥698.51
    • 3+

      ¥216.5381 ¥698.51
    • 5+

      ¥146.6871 ¥698.51
    • 30+

      ¥141.9306 ¥675.86
  • 有货
  • 现场可编程门阵列 (FPGA) 专为满足高容量、对成本敏感的消费电子应用需求而设计。该系列有五个成员,密度范围从100,000到160万系统门。基于早期Spartan-3系列的成功,增加了每个I/O的逻辑量,显著降低了每个逻辑单元的成本。新特性提高了系统性能并降低了配置成本。结合先进的90纳米工艺技术,每美元能提供更多功能和带宽。由于成本极低,非常适合广泛的消费电子应用,包括宽带接入、家庭网络、显示/投影和数字电视设备。是掩膜编程ASIC的优质替代方案,避免了传统ASIC的高初始成本、长开发周期和固有灵活性不足的问题。此外,FPGA的可编程性允许在现场进行设计升级,无需更换硬件。
    数据手册
    • 1+

      ¥336.4624 ¥820.64
    • 3+

      ¥254.3984 ¥820.64
    • 5+

      ¥172.3344 ¥820.64
    • 30+

      ¥166.7442 ¥794.02
  • 有货
    • 1+

      ¥420.32
    • 30+

      ¥399.2
  • 有货
  • 7系列FPGA包括四个FPGA系列,可满足从低成本、小尺寸、对成本敏感的大批量应用到超高端连接带宽、逻辑容量和信号处理能力的最苛刻高性能应用的系统要求。这些系列包括Spartan-7、Artix-7、Kintex-7和Virtex-7。Spartan-7针对低成本、低功耗和高I/O性能进行了优化;Artix-7针对需要串行收发器和高DSP及逻辑吞吐量的低功耗应用进行了优化;Kintex-7针对最佳性价比进行了优化;Virtex-7针对最高系统性能和容量进行了优化。7系列FPGA基于先进的高性能、低功耗(HPL)、28nm、高k金属栅极(HKMG)工艺技术构建,在提供2.9Tb/s的I/O带宽、200万个逻辑单元容量和5.3TMAC/s DSP的同时,比上一代设备功耗降低50%,可作为ASSP和ASIC的完全可编程替代方案
    数据手册
    • 1+

      ¥444.8261 ¥2341.19
    • 30+

      ¥430.3994 ¥2265.26
  • 有货
  • Field-Programmable Gate Arrays (FPGAs) 解决了大多数高产量、对成本敏感、I/O 密集型电子应用中的设计挑战。该系列有五个成员,密度范围从 50,000 到 140 万系统门。Spartan-3A FPGAs 是 Extended Spartan-3A 系列的一部分,该系列还包括非易失性的 Spartan-3AN 和更高密度的 Spartan-3A DSP FPGAs。Spartan-3A 系列在早期的 Spartan-3E 和 Spartan-3 FPGA 系列的成功基础上发展而来。新功能提高了系统性能并降低了配置成本。这些 Spartan-3A 系列的改进,结合成熟的 90 nm 工艺技术,提供了前所未有的每美元更多的功能和带宽,为可编程逻辑行业设定了新的标准
    • 1+

      ¥476
    • 30+

      ¥460
  • 有货
  • 涵盖四个FPGA系列,可满足从低成本、小尺寸、对成本敏感的大批量应用到超高端连接带宽、逻辑容量和信号处理能力的最苛刻高性能应用的全系列系统要求。基于先进的高性能、低功耗(HPL)28nm高k金属栅极(HKMG)工艺技术,与上一代器件相比,可使系统性能大幅提升,具备2.9Tb/s的I/O带宽、200万个逻辑单元容量和5.3TMAC/s的DSP,同时功耗降低50%,为ASSP和ASIC提供了完全可编程的替代方案。
    数据手册
    • 1+

      ¥506.46
    • 27+

      ¥481.36
  • 有货
  • 7系列FPGA包括四个FPGA系列,可满足从低成本、小尺寸、对成本敏感的大批量应用到超高端连接带宽、逻辑容量和信号处理能力的最苛刻高性能应用的系统要求。这些系列包括Spartan-7、Artix-7、Kintex-7和Virtex-7。Spartan-7针对低成本、低功耗和高I/O性能进行了优化;Artix-7针对需要串行收发器和高DSP及逻辑吞吐量的低功耗应用进行了优化;Kintex-7针对最佳性价比进行了优化;Virtex-7针对最高系统性能和容量进行了优化。7系列FPGA基于先进的高性能、低功耗(HPL)、28nm、高k金属栅极(HKMG)工艺技术构建,在提供2.9Tb/s的I/O带宽、200万个逻辑单元容量和5.3TMAC/s DSP的同时,比上一代设备功耗降低50%,可作为ASSP和ASIC的完全可编程替代方案
    • 单价:

      ¥623.76 / 个
  • 有货
  • 旨在同时满足不断缩小的功耗、成本和上市时间要求,以及高容量和对成本敏感应用不断增长的带宽要求。集成了收发器和硬内存控制器,适用于工业、无线和有线、汽车市场的应用。
    数据手册
    • 1+

      ¥649.2596 ¥1583.56
    • 10+

      ¥490.9036 ¥1583.56
    • 30+

      ¥332.5476 ¥1583.56
  • 有货
  • 该现场可编程门阵列系列为用户提供高性能、丰富的逻辑资源和强大的功能集,且价格极低。该系列有六个成员,密度范围从15,000到200,000系统门,系统性能支持高达200 MHz。其功能包括块RAM(高达56K位)、分布式RAM(高达75,264位)、16种可选的I/O标准和四个DLL。快速、可预测的互连意味着后续的设计迭代能够继续满足时序要求。该系列是掩膜编程ASIC的优质替代品。FPGA避免了传统ASIC的初始成本、漫长的开发周期和固有风险。此外,FPGA的可编程性允许在现场进行设计升级,无需更换硬件(这是ASIC无法做到的)。
    • 1+

      ¥695.5
    • 30+

      ¥669.5
  • 有货
  • 7系列FPGA包括四个FPGA系列,可满足从低成本、小尺寸、对成本敏感的大批量应用到超高端连接带宽、逻辑容量和信号处理能力的最苛刻高性能应用的系统要求。这些系列包括Spartan-7、Artix-7、Kintex-7和Virtex-7。Spartan-7针对低成本、低功耗和高I/O性能进行了优化;Artix-7针对需要串行收发器和高DSP及逻辑吞吐量的低功耗应用进行了优化;Kintex-7针对最佳性价比进行了优化;Virtex-7针对最高系统性能和容量进行了优化。7系列FPGA基于先进的高性能、低功耗(HPL)、28nm、高k金属栅极(HKMG)工艺技术构建,在提供2.9Tb/s的I/O带宽、200万个逻辑单元容量和5.3TMAC/s DSP的同时,比上一代设备功耗降低50%,可作为ASSP和ASIC的完全可编程替代方案
    • 1+

      ¥714.2036 ¥1741.96
    • 3+

      ¥540.0076 ¥1741.96
    • 5+

      ¥365.8116 ¥1741.96
    • 30+

      ¥353.9466 ¥1685.46
  • 有货
  • UltraScale架构包含高性能FPGA、MPSoC和RFSoC系列,通过众多创新技术进步满足广泛的系统需求,重点是降低总功耗。Kintex UltraScale FPGAs:高性能FPGA,注重性价比,采用单片和下一代堆叠硅互连(SSI)技术。高DSP和块RAM与逻辑比以及下一代收发器,结合低成本封装,实现性能和成本的最佳平衡。Kintex UltraScale + FPGAs:提高了性能和片上UltraRAM内存,以降低物料清单成本。是高性能外设和高性价比系统实施的理想组合。具有多种电源选项,可在所需系统性能和最小功耗之间实现最佳平衡
    数据手册
    • 1+

      ¥1089.96
    • 30+

      ¥1030
  • 有货
  • Spartan-3 FPGA系列专为满足高产量、对成本敏感的消费电子应用需求而设计。该系列有八个成员,密度范围从50,000到5,000,000个系统门。它在早期Spartan-IIE系列的基础上,增加了逻辑资源、内部RAM容量、I/O总数和整体性能,同时改进了时钟管理功能。结合先进的工艺技术,每美元能提供更多功能和带宽,为可编程逻辑行业树立了新标准
    数据手册
    • 1+

      ¥1133.6213 ¥2764.93
    • 3+

      ¥857.1283 ¥2764.93
    • 5+

      ¥580.6353 ¥2764.93
    • 30+

      ¥561.8025 ¥2675.25
  • 有货
  • FPGA为用户提供高性能、丰富的逻辑资源和丰富的功能集,且价格极低。该系列有六个成员,密度范围从15,000到200,000个系统门,系统性能支持高达200 MHz。功能包括块RAM(至56K位)、分布式RAM(至75,264位)、16种可选I/O标准和四个DLL。快速、可预测的互连意味着后续的设计迭代能够继续满足时序要求。FPGA是掩膜编程ASIC的绝佳替代品,避免了传统ASIC的初始成本、漫长的开发周期和固有风险。此外,FPGA的可编程性允许在现场进行设计升级,无需更换硬件。
    • 单价:

      ¥1236 / 个
  • 有货
  • 采用第二代ASMBL(高级硅模块化块)基于列的架构,包含五个不同的平台,每个平台包含不同比例的特性,以满足各种高级逻辑设计的需求。除了最先进、高性能的逻辑结构外,还包含许多硬IP系统级模块,如强大的36-Kbit块RAM/FIFO、第二代25×18 DSP切片、具有内置数字控制阻抗的SelectIO技术、ChipSync源同步接口模块、系统监控功能、增强的时钟管理模块以及先进的配置选项。这些特性使高级逻辑设计人员能够在基于FPGA的系统中实现最高水平的性能和功能。基于65纳米先进铜工艺技术,是定制ASIC技术的可编程替代方案,为高性能逻辑设计人员、高性能DSP设计人员和高性能嵌入式系统设计人员提供了最佳解决方案
    数据手册
    • 1+

      ¥1534.6136 ¥3742.96
    • 10+

      ¥1160.3176 ¥3742.96
    • 30+

      ¥786.0216 ¥3742.96
  • 有货
  • 旨在同时满足不断缩小的功耗、成本和上市时间要求,以及高容量和对成本敏感应用不断增长的带宽要求。集成了收发器和硬内存控制器,适用于工业、无线和有线、汽车市场的应用。
    数据手册
    • 1+

      ¥1770.708 ¥4318.8
    • 10+

      ¥1338.828 ¥4318.8
    • 30+

      ¥906.948 ¥4318.8
  • 有货
  • 专为易用性而设计。成本优化的40nm器件系列架构,具有低功耗可编程逻辑引擎以及精简的收发器和I/O。借助Quartus II软件、SOFC Builder设计软件以及丰富的软硬知识产权(IP)解决方案,可在设计中轻松实现常见接口,如PCI Express (PCIe)物理接口、以太网和DDR3内存。适用于要求收发器运行速度高达6.375 Gbps的应用设计。
    数据手册
    • 1+

      ¥1770.708 ¥4318.8
    • 10+

      ¥1338.828 ¥4318.8
    • 30+

      ¥906.948 ¥4318.8
  • 有货
  • UltraScale架构包含高性能FPGA、MPSoC和RFSoC系列,通过众多创新技术进步满足广泛的系统需求,重点是降低总功耗。Kintex UltraScale FPGAs:高性能FPGA,注重性价比,采用单片和下一代堆叠硅互连(SSI)技术。高DSP和块RAM与逻辑比以及下一代收发器,结合低成本封装,实现性能和成本的最佳平衡。Kintex UltraScale + FPGAs:提高了性能和片上UltraRAM内存,以降低物料清单成本。是高性能外设和高性价比系统实施的理想组合。具有多种电源选项,可在所需系统性能和最小功耗之间实现最佳平衡
    数据手册
    • 1+

      ¥2268.7236 ¥5156.19
    • 3+

      ¥1753.1046 ¥5156.19
    • 5+

      ¥1237.4856 ¥5156.19
    • 30+

      ¥1197.348 ¥4988.95
  • 有货
  • 提供一个小型、低功耗的组件,用于常用的混合信号功能。用户通过对一次性非易失性存储器 (NVM) 进行编程,来配置互连逻辑、I/O 引脚和宏单元,从而创建电路设计。该多功能设备允许在一个非常小的、低功耗的单集成电路中设计各种混合信号功能。额外的电源 (VDD2) 提供了在同一设计中连接两个独立电压域的能力。用户可以将专用于每个电源的引脚配置为输入、输出或两者(由内部逻辑动态控制),以连接到 VDD 和 VDD2 电压域。使用可用的宏单元,设计人员可以实现跨两个域的混合信号功能,或简单地在高到低和低到高方向上进行电平转换
    • 1+

      ¥4.64
    • 10+

      ¥4.52
    • 30+

      ¥4.45
  • 有货
  • 提供了一个小型、低功耗的组件,用于常用的混合信号功能。用户通过对多次可编程非易失性存储器 (NVM) 进行编程,来配置互连逻辑、IO 和宏单元。双电源允许灵活连接两个独立的电压域。这种高度通用的设备允许在一个非常小的、低功耗的单集成电路中设计各种混合信号功能。
    • 1+

      ¥11.51
    • 10+

      ¥11.24
    • 30+

      ¥11.05
  • 有货
  • SLG46533提供了一个用于常用混合信号功能的小型低功耗组件。用户通过编程一次性非易失性存储器(NVM)来配置互连逻辑、IO引脚和SLG46533的宏单元,从而创建他们的电路设计。这种高度通用的设备允许在非常小且低功耗的单个集成电路中设计多种多样的混合信号功能。该设备中的宏单元包括以下部分:四个模拟比较器(ACMP)、两个电压参考(Vref)、二十六个组合功能宏单元、三个可选DFF/锁存或2位查找表、十二个可选DFF/锁存或3位查找表、一个可选管道延迟或3位查找表、一个可选可编程模式生成器或2位查找表、五个8位延迟/计数器或3位查找表、两个16位延迟/计数器或4位查找表、两个带有边沿检测器的消抖滤波器、组合逻辑、一个4位查找表、串行通信、符合I2C协议的16X8 RAM存储器(具有定义的NVM OTP初始状态)、管道延迟-16级/3输出(组合功能宏单元的一部分)、可编程延迟、两个振荡器(OSC)- 可配置25 kHz/2 MHz、25 MHz RC振荡器、晶体振荡器、上电复位(POR)以及一个模拟温度传感器。
    • 1+

      ¥15.05
    • 10+

      ¥14.71
    • 30+

      ¥14.48
  • 有货
  • 是高性能EECMOS可编程逻辑器件(PLD),采用电可擦除(EE)闪存技术。提供低至5ns的速度和100μA引脚控制的掉电模式选项。所有速度范围在工业温度范围的5V±10%和商业范围5V器件的5V±5%内指定。集成了通用架构的超集,允许直接替换16R8系列和大多数20引脚组合PLD
    • 1+

      ¥23.92
    • 10+

      ¥23.31
    • 30+

      ¥22.91
  • 有货
  • ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件(CPLD),采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入,能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚,具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈,该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后,每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项,连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链,每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性,能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成:乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项,以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节(16位)的用户签名,用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何,都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程(ISP)器件。它使用行业标准的4引脚JTAG接口(IEEE Std. 1149.1),并完全符合JTAG的边界扫描描述语言(BSDL)。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外,ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项,以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平,然后处于浮空状态时,它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平,从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻,并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时,ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗,还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗,每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置,以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下,电流降至10mA以下。
    数据手册
    • 1+

      ¥25.62
    • 10+

      ¥24.95
    • 30+

      ¥24.5
  • 有货
  • ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件(CPLD),采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入,能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚,具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈,该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后,每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项,连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链,每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性,能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成:乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项,以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节(16位)的用户签名,用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何,都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程(ISP)器件。它使用行业标准的4引脚JTAG接口(IEEE Std. 1149.1),并完全符合JTAG的边界扫描描述语言(BSDL)。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外,ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项,以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平,然后处于浮空状态时,它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平,从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻,并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时,ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗,还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗,每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置,以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下,电流降至10mA以下。
    数据手册
    • 1+

      ¥28.02
    • 10+

      ¥27.33
    • 30+

      ¥26.87
  • 有货
  • 是高性能CMOS(电可擦除)可编程逻辑器件(PLD),采用经过验证的电可擦除闪存技术。提供低至5ns的速度和低至10μA(典型值)的功耗。所有速度范围均在军事和工业温度范围的5V±10%范围内以及商业温度范围的5V±5%范围内指定。有几种低功耗选项,可针对各种类型的功率受限应用选择最佳解决方案,能显著降低系统总功率并提高系统可靠性。
    • 1+

      ¥28.95
    • 10+

      ¥28.38
    • 30+

      ¥25.08
  • 有货
    • 1+

      ¥31.15
    • 10+

      ¥26.6
    • 30+

      ¥23.89
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  • ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件(CPLD),采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入,能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚,具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈,该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后,每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项,连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链,每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性,能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成:乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项,以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节(16位)的用户签名,用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何,都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程(ISP)器件。它使用行业标准的4引脚JTAG接口(IEEE Std. 1149.1),并完全符合JTAG的边界扫描描述语言(BSDL)。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外,ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项,以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平,然后处于浮空状态时,它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平,从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻,并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时,ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗,还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗,每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置,以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下,电流降至10mA以下。
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