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单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
数据手册
  • 1+

    ¥256.19
  • 10+

    ¥248.2
  • 有货
  • 旨在同时满足不断缩小的功耗、成本和上市时间要求,以及高容量和对成本敏感应用不断增长的带宽要求。集成了收发器和硬内存控制器,适用于工业、无线和有线、汽车市场的应用。
    数据手册
    • 1+

      ¥299.87
    • 10+

      ¥289.38
  • 有货
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      ¥405.69
    • 30+

      ¥385.31
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,可满足I/O扩展和芯片间接口的要求,其架构适用于多个市场领域的智能和互联终端应用。
    • 单价:

      ¥452.62 / 个
  • 有货
  • 旨在同时满足不断缩小的功耗、成本和上市时间要求,以及高容量和对成本敏感应用不断增长的带宽要求。集成了收发器和硬内存控制器,适用于工业、无线和有线、汽车市场的应用。
    数据手册
    • 1+

      ¥469.7
    • 30+

      ¥452.62
  • 有货
  • Cyclone III 器件系列提供了一种独特的高功能、低功耗和低成本的组合。基于台湾半导体制造公司(TSMC)的低功耗(LP)工艺技术、硅优化以及软件特性来最小化功耗,Cyclone III 器件系列为大批量、低功耗和成本敏感的应用提供了理想的解决方案。为了满足独特的设计需求,Cyclone III 器件系列提供了两个变体:- **Cyclone III**:最低功耗,高功能且成本最低。- **Cyclone III LS**:具有安全性的最低功耗FPGA。该系列器件的逻辑单元(LEs)密度范围从5K到200K,内存从0.5 Mbits到8 Mbits,静态功耗低于1%瓦特,使得更容易满足功耗预算。Cyclone III LS 器件是首个在低功耗和高功能FPGA平台上实现硅级、软件级和知识产权(IP)级别一系列安全特性的产品。这套安全特性保护了IP免受篡改、逆向工程和克隆的影响。此外,Cyclone III LS 器件支持设计分离,这使得能够在单个芯片中实现冗余以减小应用的尺寸、重量和功耗。
    • 1+

      ¥512.81
    • 30+

      ¥488.4
  • 有货
    • 1+

      ¥561.28
    • 10+

      ¥543.04
  • 有货
  • 特性:低功耗嵌入式处理解决方案。 低成本DSP解决方案。 时钟乘法和除法。 可编程占空比。 相移实现。 手动时钟切换。 奇偶校验位支持。 字节使能支持。 打包模式支持。 地址时钟使能。 单端口模式。 简单双端口模式。 真双端口模式。 移位寄存器模式。 ROM模式。 FIFO缓冲模式。 独立时钟模式。 输入/输出时钟模式。 读/写时钟模式。 单时钟模式
    数据手册
    • 单价:

      ¥1423.89 / 个
  • 有货
    • 1+

      ¥106.84
    • 10+

      ¥103.42
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    • 20+

      ¥133.4
    • 40+

      ¥127.6
    • 200+

      ¥124.12
    FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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    • 单价:

      ¥173.57 / 个
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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    • 1+

      ¥201.75
    • 30+

      ¥192.39
  • 有货
  • 特性:低功耗嵌入式处理解决方案。 低成本DSP解决方案。 时钟乘法和除法。 可编程占空比。 相移实现。 手动时钟切换。 奇偶校验位支持。 字节使能支持。 打包模式支持。 地址时钟使能。 单端口模式。 简单双端口模式。 真双端口模式。 移位寄存器模式。 ROM模式。 FIFO缓冲模式。 独立时钟模式。 输入/输出时钟模式。 读/写时钟模式。 单时钟模式
    • 单价:

      ¥303.46 / 个
  • 有货
    • 1+

      ¥44.4768
    • 20+

      ¥42.6688
    • 100+

      ¥41.584
    • 200+

      ¥39.776
    • 500+

      ¥39.0528
    本章描述了Cyclone IV器件的电气和开关特性。电气特性包括工作条件和功耗。开关特性包括收发器规格、核心和外围性能。本章还描述了I/O时序,包括可编程I/O元件(IOE)延迟和可编程输出缓冲器延迟。
    数据手册
    • 5+

      ¥156.468
    • 10+

      ¥138.414
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      ¥132.396
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      ¥128.7852
    • 1+

      ¥405.14
    • 30+

      ¥385.06
  • 订货
    • 10+

      ¥22.44
    • 100+

      ¥20.196
    • 540+

      ¥18.7
    • 2700+

      ¥16.524
    单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
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    • 单价:

      ¥58.5792 / 个
    特性:低功耗嵌入式处理解决方案。 低成本DSP解决方案。 时钟乘法和除法。 可编程占空比。 相移实现。 手动时钟切换。 奇偶校验位支持。 字节使能支持。 打包模式支持。 地址时钟使能。 单端口模式。 简单双端口模式。 真双端口模式。 移位寄存器模式。 ROM模式。 FIFO缓冲模式。 独立时钟模式。 输入/输出时钟模式。 读/写时钟模式。 单时钟模式
    • 5+

      ¥237.77
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      ¥210.335
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      ¥201.19
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      ¥195.703
    单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
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      ¥150.442776
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      ¥146.339791
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      ¥30
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      ¥11
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      ¥92.575
    • 100+

      ¥88.55
    • 1000+

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      ¥163.35
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      ¥155.25
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  • 旨在同时满足不断缩小的功耗、成本和上市时间要求,以及高容量和对成本敏感应用不断增长的带宽要求。集成了收发器和硬内存控制器,适用于工业、无线和有线、汽车市场的应用。
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