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首页 > 热门关键词 > 阿尔特拉FPGA
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  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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      ¥154.47
  • 有货
  • 单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
    数据手册
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      ¥160.75
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      ¥154.99
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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      ¥324.11
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  • 继第一代Cyclone器件系列取得巨大成功之后,Cyclone II FPGA将低成本FPGA的密度范围扩展到68,416个逻辑单元(LE),并提供多达622个可用I/O引脚和多达1.1 Mbit的嵌入式存储器。Cyclone II FPGA采用台积电的90 nm低k介质工艺在300 mm晶圆上制造,以确保快速供货和低成本。通过最小化硅片面积,Cyclone II器件能够以与ASIC相媲美的成本在单个芯片上支持复杂的数字系统。与其他为降低成本而牺牲功耗和性能的FPGA供应商不同,Altera最新一代低成本FPGA——Cyclone II FPGA,与竞争的90 nm FPGA相比,性能提高60%,功耗降低一半
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  • 特性:低功耗嵌入式处理解决方案。 低成本DSP解决方案。 时钟乘法和除法。 可编程占空比。 相移实现。 手动时钟切换。 奇偶校验位支持。 字节使能支持。 打包模式支持。 地址时钟使能。 单端口模式。 简单双端口模式。 真双端口模式。 移位寄存器模式。 ROM模式。 FIFO缓冲模式。 独立时钟模式。 输入/输出时钟模式。 读/写时钟模式。 单时钟模式
    • 1+

      ¥1413.065 ¥3446.5
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      ¥1068.415 ¥3446.5
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  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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      ¥1876.2
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  • 是低成本、高性能设备,基于MAX架构。采用先进CMOS技术制造,基于EEPROM,工作电源电压为3.3V,提供600至10,000个可用门、在系统可编程(ISP)、引脚到引脚延迟最快达4.5 ns,计数器速度高达227.3 MHz。4、-5、-6、-7和-10速度等级的设备与PCI特殊兴趣小组(PCI SIG)PCI本地总线规范2.2版的时序要求兼容。MAX 3000A架构支持100%晶体管-晶体管逻辑(TTL)仿真以及高密度小规模集成(SSI)、中规模集成(MSI)和大规模集成(LSI)逻辑功能
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    • 1+

      ¥41.92
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      ¥41.59
    • 30+

      ¥40.92
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  • 单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
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      ¥49.52
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      ¥68.95
    • 30+

      ¥63.06
  • 有货
  • 基于1.5-V、0.13-μm全层铜SRAM工艺,密度高达20,060个逻辑单元(LE)和高达288 Kbits的RAM。具有锁相环(PLL)用于时钟和专用双倍数据速率(DDR)接口,以满足DDR SDRAM和快速循环RAM(FCRAM)内存要求,是数据路径应用的经济高效解决方案。支持各种I/O标准,包括数据速率高达640 Mbps的LVDS,以及66-和33-MHz、64-和32位的外围组件互连(PCI),用于与ASSP和ASIC设备接口和支持。还提供新的低成本串行配置设备来配置。
    • 1+

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    • 10+

      ¥95.69
    • 60+

      ¥87.21
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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      ¥104.19
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      ¥99.29
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      ¥90.81
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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    • 1+

      ¥116.62
    • 10+

      ¥112.54
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  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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      ¥117.17
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      ¥113.33
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  • 基于1.5-V、0.13-μm全层铜SRAM工艺,密度高达20,060个逻辑单元(LE)和高达288 Kbits的RAM。具有锁相环(PLL)用于时钟和专用双倍数据速率(DDR)接口,以满足DDR SDRAM和快速循环RAM(FCRAM)内存要求,是数据路径应用的经济高效解决方案。支持各种I/O标准,包括数据速率高达640 Mbps的LVDS,以及66-和33-MHz、64-和32位的外围组件互连(PCI),用于与ASSP和ASIC设备接口和支持。还提供新的低成本串行配置设备来配置。
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      ¥248.05
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  • 特性:最低功耗FPGA。 设计安全特性。 增加系统集成。 逻辑单元和逻辑阵列块
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    • 30+

      ¥364.55
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  • Cyclone III 器件系列将高功能性、低功耗和低成本独特结合。基于台积电低功耗 (LP) 工艺技术、硅优化和软件特性以最小化功耗,为大批量、低功耗和对成本敏感的应用提供理想解决方案。该系列有两种变体:Cyclone III 具备最低功耗、高功能性和最低成本;Cyclone III LS 是具备安全性的最低功耗 FPGA。其逻辑单元 (LE) 密度范围约为 5,000 至 200,000,内存为 0.5 兆比特 (Mb) 至 8 Mb,静态功耗低于 1 瓦,更易满足功率预算
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    • 1+

      ¥536.8
    • 30+

      ¥517.28
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  • Cyclone III 器件系列提供了一种独特的高功能、低功耗和低成本的组合。基于台湾半导体制造公司(TSMC)的低功耗(LP)工艺技术、硅优化以及软件特性来最小化功耗,Cyclone III 器件系列为大批量、低功耗和成本敏感的应用提供了理想的解决方案。为了满足独特的设计需求,Cyclone III 器件系列提供了两个变体:- **Cyclone III**:最低功耗,高功能且成本最低。- **Cyclone III LS**:具有安全性的最低功耗FPGA。该系列器件的逻辑单元(LEs)密度范围从5K到200K,内存从0.5 Mbits到8 Mbits,静态功耗低于1%瓦特,使得更容易满足功耗预算。Cyclone III LS 器件是首个在低功耗和高功能FPGA平台上实现硅级、软件级和知识产权(IP)级别一系列安全特性的产品。这套安全特性保护了IP免受篡改、逆向工程和克隆的影响。此外,Cyclone III LS 器件支持设计分离,这使得能够在单个芯片中实现冗余以减小应用的尺寸、重量和功耗。
    • 1+

      ¥779.34
    • 30+

      ¥740.72
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      ¥28.11
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      ¥25.3
  • 有货
  • FPGA针对低成本和低静态功耗进行了优化,非常适合高产量和对成本敏感的应用。提供高密度的可编程门、板载资源和通用I/O,满足I/O扩展和芯片到芯片接口的要求。其架构适用于许多市场领域的智能和连接终端应用。
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    • 1+

      ¥89.76
    • 10+

      ¥86.88
  • 有货
  • 单芯片、非易失性低成本可编程逻辑器件 (PLD),用于集成最佳系统组件集合。亮点包括内部存储的双配置闪存、用户闪存、即时启动支持、集成模数转换器 (ADC)、单芯片 Nios II 软核处理器支持。是系统管理、I/O 扩展、通信控制平面、工业、汽车和消费应用的理想解决方案。
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