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首页 > 热门关键词 > P美国微芯逻辑芯片
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  • 是高性能CMOS电可擦除可编程逻辑器件(EE PLD),采用经过验证的电可擦除闪存技术。所有速度范围均在工业温度范围内的5.0V±10%范围内指定。ATF16V8BQL提供边缘感应低功耗PLD解决方案,待机功耗低(典型值为5mA)。当设备空闲时,ATF16V8BQL通过输入转换检测(ITD)电路自动进入低功耗模式。ATF16V8B(QL)集成了通用架构的超集,可直接替代16R8系列和大多数20引脚组合PLD。八个输出各分配八个乘积项。三种不同的操作模式,通过软件自动配置,可实现高度复杂的逻辑功能。
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  • 是高性能CMOS电可擦除可编程逻辑器件(EE PLD),采用经过验证的电可擦除闪存技术。所有速度范围均在工业温度范围内的5.0V±10%范围内指定。ATF16V8BQL提供边缘感应低功耗PLD解决方案,待机功耗低(典型值为5mA)。当设备空闲时,ATF16V8BQL通过输入转换检测(ITD)电路自动进入低功耗模式。ATF16V8B(QL)集成了通用架构的超集,可直接替代16R8系列和大多数20引脚组合PLD。八个输出各分配八个乘积项。三种不同的操作模式,通过软件自动配置,可实现高度复杂的逻辑功能。
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  • 是高性能、高密度复杂PLD。基于先进的闪存技术,最大引脚到引脚延迟为7.5 ns,支持高达125 MHz的时序逻辑操作。拥有32个逻辑宏单元和多达36个输入,可轻松集成多个TTL、SSI、MSI和经典PLD的逻辑。全局输入和反馈架构简化了逻辑布局,消除了因设计变更而导致的引脚排列变化。
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  • 是一种高性能、高密度的复杂可编程逻辑器件 (CPLD),采用了经过验证的电可擦除存储技术。拥有64个逻辑宏单元和多达68个输入,可轻松集成来自多个TTL、SSI、MSI、LSI和传统PLD的逻辑。增强的路由开关矩阵增加了可用门数和成功进行引脚锁定设计修改的几率。 拥有多达68个双向I/O引脚和4个专用输入引脚,具体取决于所选的器件封装类型。每个专用引脚还可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元内单独选择使用
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      ¥53.1924 ¥69.99
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  • 是高性能、高密度的复杂可编程逻辑器件 (CPLD),采用电可擦除技术。拥有128个逻辑宏单元和多达100个输入,可轻松集成多个TTL、SSI、MSI、LSI和经典PLD的逻辑。增强型路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。根据所选的器件封装类型,最多有96个双向I/O引脚和4个专用输入引脚。每个专用引脚还可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元内单独选择使用。128个宏单元中的每一个都会产生一个埋入式反馈,连接到全局总线。每个输入和I/O引脚也会馈入全局总线
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      ¥43.9419 ¥61.89
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  • 该产品是一款高性能CMOS(电可擦除)可编程逻辑器件(PLD),采用成熟的电可擦除技术。它采用44引脚表面贴装封装,具有全连接逻辑阵列和灵活的宏单元结构,可实现高门利用率。所有引脚和反馈项始终可供每个宏单元使用。每个和项输入四个乘积项,每个宏单元的三个和项可组合,每个和项最多可提供12个乘积项且不影响性能。每个触发器可单独选择为D型或T型,24个触发器可旁路以提供内部组合反馈。乘积项为每个触发器提供单独的时钟和异步复位,触发器也可配置为直接输入引脚时钟。每个输出都有自己的使能乘积项,八个同步预设乘积项服务于四个或八个触发器的本地组,提供寄存器预加载功能,所有寄存器在上电时自动复位。
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      ¥88.3652 ¥116.27
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      ¥247.04
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  • ProASIC3是第三代闪存FPGA,性能、密度和功能优于ProASICPLUS系列。非易失性闪存技术使ProASIC3器件具有安全、低功耗、单芯片解决方案和即时启动的优势。它可重新编程,以ASIC级单位成本提供上市时间优势,使设计人员能够使用现有的ASIC或FPGA设计流程和工具创建高密度系统。ProASIC3器件提供1 kbit片上可重新编程的非易失性FlashROM存储,以及基于集成锁相环(PLL)的时钟调节电路
    • 1+

      ¥1165.48
    • 30+

      ¥1109.72
  • 有货
  • 是高性能CMOS电可擦除可编程逻辑器件(EE PLD),采用经过验证的电可擦除闪存技术。所有速度范围均在工业温度范围内的5.0V±10%范围内指定。ATF16V8BQL提供边缘感应低功耗PLD解决方案,待机功耗低(典型值为5mA)。当设备空闲时,ATF16V8BQL通过输入转换检测(ITD)电路自动进入低功耗模式。ATF16V8B(QL)集成了通用架构的超集,可直接替代16R8系列和大多数20引脚组合PLD。八个输出各分配八个乘积项。三种不同的操作模式,通过软件自动配置,可实现高度复杂的逻辑功能。
    • 1+

      ¥15.93
    • 10+

      ¥13.52
    • 48+

      ¥12.01
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  • ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件(CPLD),采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入,能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚,具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈,该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后,每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项,连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链,每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性,能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成:乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项,以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节(16位)的用户签名,用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何,都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程(ISP)器件。它使用行业标准的4引脚JTAG接口(IEEE Std. 1149.1),并完全符合JTAG的边界扫描描述语言(BSDL)。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外,ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项,以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平,然后处于浮空状态时,它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平,从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻,并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时,ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗,还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗,每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置,以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下,电流降至10mA以下。
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      ¥25.62
    • 10+

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    • 30+

      ¥24.5
  • 有货
  • ATF1502AS(L)是一款高性能、高密度的复杂可编程逻辑器件(CPLD),采用了成熟的电可擦除技术。它拥有32个逻辑宏单元和多达36个输入,能够轻松集成多个TTL、SSI、MSI、LSI和传统PLD的逻辑。ATF1502AS(L)增强的路由开关矩阵增加了可用门数,提高了引脚锁定设计修改成功的几率。ATF1502AS(L)最多有32个双向I/O引脚和4个专用输入引脚,具体数量取决于所选的器件封装类型。每个专用引脚可作为全局控制信号、寄存器时钟、寄存器复位或输出使能。这些控制信号可在每个宏单元中单独选择使用。32个宏单元中的每一个都会产生一个内部反馈,该反馈会连接到全局总线。每个输入和I/O引脚也会接入全局总线。然后,每个逻辑块中的开关矩阵会从全局总线中选择40个独立信号。每个宏单元还会产生一个反馈逻辑项,连接到区域总线。ATF1502AS(L)宏单元之间的级联逻辑能够快速、高效地生成复杂逻辑功能。ATF1502AS(L)包含4条这样的逻辑链,每条逻辑链最多可创建具有40个乘积项扇入的和项逻辑。ATF1502AS(L)宏单元具有足够的灵活性,能够支持高速运行的高度复杂逻辑功能。宏单元由五个部分组成:乘积项和乘积项选择多路复用器或/异或/级联逻辑触发器输出选择和使能逻辑阵列输入编译器会自动禁用未使用的乘积项,以降低功耗。编程后的安全熔丝可保护ATF1502AS(L)的内容。用户可访问两个字节(16位)的用户签名,用于存储项目名称、部件编号、版本或日期等信息。无论安全熔丝状态如何,都可访问用户签名。ATF1502AS(L)器件是一种在系统可编程(ISP)器件。它使用行业标准的4引脚JTAG接口(IEEE Std. 1149.1),并完全符合JTAG的边界扫描描述语言(BSDL)。ISP允许在不将器件从印刷电路板上移除的情况下进行编程。除了简化制造流程外,ISP还允许通过软件在现场进行设计修改。ATF1502AS(L)提供对所有输入和I/O引脚进行编程的选项,以便使用引脚保持电路。当任何引脚被驱动为高电平或低电平,然后处于浮空状态时,它将保持在之前的高电平或低电平。该电路可防止未使用的输入和I/O线路浮空到中间电压电平,从而避免不必要的功耗和系统噪声。保持电路无需外部上拉电阻,并消除了它们的直流功耗。ATF1502AS(L)具有多种内置的速度和电源管理功能。当没有逻辑转换发生时,ATF1502AS(L)中的电路会自动将器件置于低功耗待机模式。这不仅能在非活动期间降低功耗,还能为大多数运行速度低于50MHz的系统应用按比例节省功耗。此功能可作为设计选项进行选择。为进一步降低功耗,每个ATF1502AS(L)宏单元都具有低功耗位功能。该功能允许对单个宏单元进行配置,以实现最大程度的节能。此功能可作为设计选项进行选择。ATF1502AS(L)还具有可选的掉电模式。在这种模式下,电流降至10mA以下。
    数据手册
    • 1+

      ¥37.1
    • 10+

      ¥31.77
    • 30+

      ¥28.52
  • 有货
  • 是高性能CMOS(电可擦除)可编程逻辑器件(PLD),采用经过验证的电可擦除闪存技术。提供低至5ns的速度和低至10μA(典型值)的功耗。所有速度范围均在工业温度范围的5V±10%范围内以及商业温度范围的5V±5%范围内指定。有几种低功耗选项,可针对各种类型的功率受限应用选择最佳解决方案,能显著降低系统总功率并提高系统可靠性。
    • 1+

      ¥29.97
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      ¥29.39
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  • CPLD - 复杂可编程逻辑器件 128 MC CPLD 10NS IND TEMP GRN
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      ¥80.398 ¥131.8
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